1楼
- 马甲张
- 2021/9/26 17:22:14
芯启源电子科技有限公司是一家针对超大规模电信和企业级的智能网络提供核心芯片和系统的高科技公司,公司聚焦网络通讯、5G、云数据中心和人工智能等领域,致力于集成电路核心知识产权(IP)、芯片设计研发、生产及销售,提供最优的芯片及IP解决方案公司构建了完善的产品体系,多年深耕芯片研发形成了完备的技术壁垒,成为国内半导体产业中的佼佼者。多款产品已先后打入国内外头部用户市场,得到业界广泛认可,其中USBIP为全球第二家、国内唯一一家获得USB-IF国际组织的官方认证。公司研发中心遍布海内外,如美国、英国、南非、上海、南京、北京等,拥有一批国内高端技术人才和海外芯片专家。
招聘职位:
FAE客户工程师
岗位职责:
1.具备智能网卡Smart NIC/DPU相关的技术背景,与销售协同处理客户关系和进行产品介绍推广
2.提供网卡产品相关的技术支持,能解决基础问题,进行现场技术指导、故障分析与排除
3.收集客户需求并正确把握市场方向,做好客户的进度跟踪和问题反馈
4.协助挖掘新客户、新市场项目机会,并协助定义下一代SmartNIC/DPU芯片需求
任职要求:
1.985/211本科学历及以上,计算机、电子等专业
2.对现代云网络和虚拟化技术有一定的了解,熟悉TCP/IP网络协议,对于二三层交换路由有较好的理解
3.学习能力强,愿意积极主动的学习新知识,并能对新知识加以运用
4.英语熟练,能快速阅读英文资料,并能做基本的口语交流
5.有良好的独立处理问题的能力,能适应短期出差
6.具有良好的团队精神和较强的人际沟通协调能力
FPGA工程师
岗位描述:
1.负责自研FPGA原型验证平台的设计、开发和调试
2.参与FPGA相关的项目,进行FPGA的RTL设计、仿真和调试
3.参与自研FPGA原型验证平台的客户支持
4.维护项目文档
任职要求:
1.计算机,电子或相关专业本科以上学历
2.较强的硬件设计能力
3.有Xilinx/Intel等FPGA经验优先
4.有Verilog、VHDL或systemverilog经验者优先
5.具有良好的沟通能力
IC设计验证工程师
岗位描述:
1.掌握并深入理解项目涉及的协议和标准
2.搭建和维护UVM验证环境
3.制定测试计划,编写和调试testcase
4.根据覆盖率计划编写功能覆盖率,并使覆盖率达标
5.日常的回归测试
6.参与和协助FPGA测试
7.协助进行软件测试和开发
任职要求:
1.微电子,计算机,电子工程,通信等相关专业
2.了解IC开发流程和芯片制造流程
3.熟悉下列设计语言中的一种或几种:verilog/VHDL,C,C++,perl,python,system Verilog
4.有System Verilog,UVM使用经验者优先
5.学习能力强,愿意积极主动的学习新知识,并能对新知识加以运用
更多职位信息请点击链接查看:
http://2022.yingjiesheng.com/corigine/jobs
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招聘职位:
FAE客户工程师
岗位职责:
1.具备智能网卡Smart NIC/DPU相关的技术背景,与销售协同处理客户关系和进行产品介绍推广
2.提供网卡产品相关的技术支持,能解决基础问题,进行现场技术指导、故障分析与排除
3.收集客户需求并正确把握市场方向,做好客户的进度跟踪和问题反馈
4.协助挖掘新客户、新市场项目机会,并协助定义下一代SmartNIC/DPU芯片需求
任职要求:
1.985/211本科学历及以上,计算机、电子等专业
2.对现代云网络和虚拟化技术有一定的了解,熟悉TCP/IP网络协议,对于二三层交换路由有较好的理解
3.学习能力强,愿意积极主动的学习新知识,并能对新知识加以运用
4.英语熟练,能快速阅读英文资料,并能做基本的口语交流
5.有良好的独立处理问题的能力,能适应短期出差
6.具有良好的团队精神和较强的人际沟通协调能力
FPGA工程师
岗位描述:
1.负责自研FPGA原型验证平台的设计、开发和调试
2.参与FPGA相关的项目,进行FPGA的RTL设计、仿真和调试
3.参与自研FPGA原型验证平台的客户支持
4.维护项目文档
任职要求:
1.计算机,电子或相关专业本科以上学历
2.较强的硬件设计能力
3.有Xilinx/Intel等FPGA经验优先
4.有Verilog、VHDL或systemverilog经验者优先
5.具有良好的沟通能力
IC设计验证工程师
岗位描述:
1.掌握并深入理解项目涉及的协议和标准
2.搭建和维护UVM验证环境
3.制定测试计划,编写和调试testcase
4.根据覆盖率计划编写功能覆盖率,并使覆盖率达标
5.日常的回归测试
6.参与和协助FPGA测试
7.协助进行软件测试和开发
任职要求:
1.微电子,计算机,电子工程,通信等相关专业
2.了解IC开发流程和芯片制造流程
3.熟悉下列设计语言中的一种或几种:verilog/VHDL,C,C++,perl,python,system Verilog
4.有System Verilog,UVM使用经验者优先
5.学习能力强,愿意积极主动的学习新知识,并能对新知识加以运用
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